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國內EDA北京華達九天科技有限公司是世界領先的中國半導體設計公司，業內知名的電源管理芯片和分立器件供應商豪威集團-上海韋爾半導體有限公司 (以下簡稱韋爾股份)已使用華大九天Empyrean Polas工具作為其可靠性分析解決方案，確保分立器件和電源芯片的設計可靠性和合理性。

Empyrean Polas是適合的IC布局設計與分立器件布局設計的可靠性和合理性分析工具相結合PCB以及包裝設計，形成完整的系統分析解決方案。

工程師可以在電源管理芯片設計中使用Polas進行Power MOS導通電阻Rdson（包括Inter-conWIZnet代理nection、PCB及Package）對導通路徑進行分析EM/IR-drop分析、MOSFET打開信號延遲和信號完整性分析，檢查芯片核心組件的全面性能可靠性。Empyrean Polas用于芯片PDN網絡、關鍵路徑網絡電阻EM/IR-drop分析可以進一步指導設計的優化。

隨著設計復雜度的提高，Power設計場景也趨于復雜。除單管外，不同類型的多管串聯也成為設計的一部分，華大九天Polas多管串聯等復雜設計的工具Rdson和EM從Rdson的分net分層次的結果展示和結果展示EM分析展示的PAD電流和分net分層次的EM/IR-drop展示,它可以幫助我們發現連接問題，PAD在保證可靠性的前提下，分布問題和可靠性問題可以減少冗余，指導優化地圖，減少芯片面積。” 豪威模擬集成電路(北京)有限公司研發總監林建輝是韋爾的子公司Polas肯定了電源管理芯片設計的性能。

在分立器件設計中，Empyrean Polas在各種工藝場景下，可以計算分立器件的導電阻Rdson，分析 conductor layer、PCB和Package設計的可靠性分析和合理性，指導設備和地圖設計、測試和包裝方案。

韋爾股份MOS設備設計經理董建新在回顧雙方的探索與合作時表示：在傳統的分離設備設計過程中，不同工藝參數下的導電阻、芯片的可靠性和測量針卡的生產都是通過連續流片、制作多版針卡和測試完成的，研發周期長，成本高，由于wafer測試的差異往往得不到預期的結論。通過與華大九天的合作，我們首次創新地將可靠性和合理性工具引入分立器設計，并在設計階段從layout模擬整個芯片各工藝參數下的導通電阻，完善可靠性方案，以及不同測試針卡下的預期測試結果。根據該方案，數十種產品的參數適配已經完成，與測試數據的誤差大多在3%以內，整體在5%以內。目前，該方案已引入設計主流程，減少研發階段流片次數和針卡制作次數，縮短研發周期，降低研發成本�！�

韋爾股份有限公司董事兼高級副總裁紀剛表示:韋爾作為國際領先的半導體公司，通過環保易用的產品提高了生活質量。在手機、電腦、電視、通信、安全、車載、穿戴、醫療等領域具有獨特的創新開放理念，專注于自主研發。秉承簡約實用的風格，Empyrean Polas它很好地滿足了韋爾的需求，解決了我們的設計痛點，幫助韋爾產品更快、更安全地進入市場，同時節省了研發和生產成本。韋爾與華大九天實現了眾望所歸的雙贏合作�！�

華大九天副總經理陸濤濤說：Empyrean Polas我們很榮幸能得到韋爾的肯定，這是華大九天模擬電路設計產品線中獨一無二的解決方案。我們的磨合過程匯集了雙方團隊中優秀的模擬設計工程師和軟件開發工程師。結合韋爾的設計痛點和華達九天的技術特點，我們創造性地為韋爾定制了一套獨家解決方案，加快韋爾產品迭代，降低韋爾產品成本，并挖掘出來Polas更多的可能性。華大九天期待著幫助韋爾在更多領域取得成功�！�